Я не могу найти, что я делаю неправильно, я был бы рад, если бы кто-нибудь мог мне помочь в этом...
entity fsmF is
port(S, R : in std_logic;
Q : out std_logic);
end;
architecture FSM_beh of fsmF is
begin
process(S, R)
begin
if S = '0' then
Q <= '0';
else
if (R'event and R = '1' and S = '1') then -- <= ERROR
Q <= '0';
else
Q <= '1';
end if;
end if;
end process;
end FSM_beh;